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EFFICIENT EXTERNAL MEMORY INTERFACE FOR MULTI-PROCESSOR PLATFORMS REALIZED ON FPGA CHIPS

机译：FpGa芯片上实现多处理器平台的高效外部存储器接口

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Hristo Nikolov; Todor Stefanov;
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年度 2015
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2. A 90-nm FPGA I/O Buffer Design With 1.6-Gb/s Data Rate for Source-Synchronous System and 300-MHz Clock Rate for External Memory Interface [J] . Jeffrey Tyhach, Bonnie Wang, Chiakang Sung, IEEE Journal of Solid-State Circuits . 2005,第9期

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3. Single Chip Embedded System Solution: Efficient Resource Utilization by Interfacing LCD through Softcore Processor in Xilinx FPGA [J] . Shiraz Afzal, Farrukh hafeez, Muhammad Ovais Akhter International Journal of Information Engineering and Electronic Business . 2015,第6期

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4. Efficient External Memory Interface for Multi-Processor Platforms Realized on FPGA Chips [C] . Nikolov Hristo, Stefanov Todor, Deprettere Ed, International Conference on Field Programmable Logic and Applications . 2007

机译：用于在FPGA芯片上实现的多处理器平台的高效外部存储器接口
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